Ich entwerfe FPGA RTL in Verilog oder VHDL mit Simulation und Testbench

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A. Yasir

Pakistan

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FPGA-Design- und Embedded-System-Ingenieur

Elektroingenieur mit Schwerpunkt auf FPGA-Design, RTL-Entwicklung und eingebettete Systeme. Ich unterstütze Kunden dabei, Spezifikationen in zuverlässige Verilog- und VHDL-Implementierungen umzusetzen...
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Über diesen Service

Willkommen bei meinem FPGA-Design-Gig. Ich entwerfe zuverlässiges RTL und digitale Logik in Verilog oder VHDL für akademische, Prototyping- und echte Hardwareprojekte.


Dieses Gig passt gut, wenn du brauchst:

- Maßgeschneiderte RTL-Module und endliche Zustandsautomaten

- UART, SPI, I2C, AXI, Speicher- oder Sensorintegration

- Testbench-Entwicklung, Simulation und Wellenform-Überprüfung

- Timing-optimierte Anpassung für Xilinx- oder Intel/Altera-Geräte

- Saubere Dokumentation und praktische Kommunikation während des gesamten Projekts


Tools, die ich verwende:

- Xilinx Vivado / ISE

- Intel Quartus Prime

- ModelSim / QuestaSim


Lieferungen können synthesefähiges RTL, Testbench-Dateien, Simulationsergebnisse sowie Timing- oder Ressourcenberichte umfassen, je nach deinen Anforderungen.


Bitte schreibe mir vor der Bestellung mit deinem Ziel-FPGA oder Board, den benötigten Schnittstellen, dem Projektumfang und der Deadline. So kann ich Machbarkeit, Preisgestaltung und Lieferzeit bestätigen, bevor wir starten.

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Plattform:

FPGA

Expertise:

Firmware-Entwicklung

•

SoC-Optimierung

•

Mikrocontroller

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