Ich werde RTL entwerfen, RTL-Code simulieren oder Codex für das Design verwenden

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Student der Informatik

Ich bin Student der Computertechnik an der UC Santa Barbara mit praktischer Erfahrung im RTL-Design, in der Simulation und Verifikation für FPGA- und ASIC-Anwendungen. Ich habe Erfahrung in der Entwic...

Über diesen Service

Suchst du zuverlässige RTL-Designs, digitale Logiksimulationen oder Unterstützung bei der PCB-Implementierung für dein Hardware-Projekt?

Ich biete maßgeschneiderte Ingenieurdienstleistungen für FPGA-, ASIC- und Embedded-Hardware-Anwendungen an. Als Student der Computertechnik an der UC Santa Barbara habe ich praktische Erfahrung im Entwerfen, Simulieren, Debuggen und Verifizieren digitaler Systeme mit SystemVerilog und Verilog.

Meine RTL-Dienste umfassen:

Kombinatorisches und sequentielles Logikdesign

Endliche Zustandsautomaten

AXI-, UART-, SPI- und I2C-Schnittstellen

Arbiters, Zähler, FIFOs, Skid-Puffer und Datenpfade

FPGA-orientierte RTL-Module

SystemVerilog-Testbenches

Funktionale Simulation und Wellenform-Debugging

Code-Review, Optimierung und Fehlerbehebung

Dokumentation und Design-Erklärungen

Meine PCB-Dienste umfassen:

Schematic Capture

PCB-Layout und Bauteilplatzierung

Grundlegendes Power- und Signalrouting

Stückliste-Erstellung

Gerber- und Fertigungsdateigeneration

Überprüfung und Debugging bestehender PCB-Designs

Ich lege Wert auf sauberes, lesbares und gut dokumentiertes Design, das auf deine Anforderungen zugeschnitten ist. Die Ergebnisse können RTL-Quelldateien, Testbenches, Simulationsergebnisse, Schaltpläne, PCB-Dateien und Gerber-Dateien umfassen