Ich entwerfe maßgeschneiderte RTL-Logik in Verilog und SystemVerilog
Hardware-Programmierer
Über diesen Service
Digital IC Design, RTL-Codierung & Verifikation
Benötigst du robusten, synthesefähigen RTL-Code und umfassende Verifikation? Ich spezialisiere mich auf effiziente Verilog- und SystemVerilog-IP-Kerne, maßgeschneiderte Datenpfade und Verifikationsumgebungen.
Was ich anbiete:
- Maßgeschneiderte RTL-Designs: Pipelines (z.B. RISC-V), Recheneinheiten und komplexe Datenpfade.
- Sequentielle & FSM-Logik: Speichercontroller, FIFOs und Mealy/Moore-Zustandsautomaten.
- SoC-Protokolle: AMBA APB, AHB und AXI Master-Slave-Schnittstellen.
- Fortgeschrittene Verifikation: Schichtweise Testbänke, SystemVerilog Assertions (SVA) und UVM.
- FPGA-Prototyping: QSF-Mapping und Platform Designer-Integration.
Tools & Hardware:
- Sprachen: Verilog, SystemVerilog, C/C++
- EDA-Tools: ModelSim, Questa Sim, Quartus, Vivado
- Ziele: Intel Cyclone IV/V (DE1-SoC, DE10-Lite), Xilinx Zynq-7000
Warum du mich wählen solltest? Ich liefere strikt synthesefähigen, gut kommentierten Code, der durch gründliche Corner-Case-Verifikation unterstützt wird, um eine fehlerfreie Hardware-Implementierung zu gewährleisten.
Plattform:
FPGA
Sensoren:
Andere
Expertise:
Debuggen
•
Mikrocontroller
•
Im Test
•
Programmierung
FAQ
Automatische Übersetzung
Welche Dateien erhalte ich?
Du erhältst alle Rohquellcodedateien (.v oder .sv) zusammen mit Testbänken und Simulationsergebnissen.
