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Ich werde RISCV-Assemblercode und ISA-basierte Designs schreiben, simulieren und debuggen.
Techniker
Ich bin Elektronikingenieur mit Expertise in FPGA-Entwicklung und RISC-Prozessordesign. Ich biete Dienstleistungen wie FPGA-Programmierung, Erstellung kundenspezifischer Module und Systemintegration m...
Level 1
Hat bestimmte Leistungskriterien erfüllt und zeigt großes Potenzial auf dem Marktplatz.
Über diesen Service
Suchst du nach Expertenhilfe bei RISC-V Assembler-Programmierung, Simulation oder Code-Integration? Ich liefere sauberen, effizienten und gut strukturierten Low-Level-Entwicklungen mit dem RISC-V Befehlssatz.
Ich spezialisiere mich auf das Schreiben und Simulieren von RISC-V Assembler-Code mit sowohl leichtgewichtigen Bildungstools wie RARS und Venus als auch professionellen Toolchains wie der RISC-V GNU Toolchain, Spike und Verilator.
Dienstleistungen umfassen:
- Optimierten und lesbaren RISC-V Assembler-Code schreiben (RV32I, RV64I, M, F)
- Code mit RARS, Venus oder Spike simulieren
- Befehlsebene Debugging und Trace-Analyse
- Testsequenzen für Kernvalidierung oder Firmware-Integration entwickeln
- Startroutinen, Speicherlayout und I/O-Interaktion erstellen (falls unterstützt)
- Code liefern, der auf Bildungs- und Profi-Plattformen läuft
Unterstützte Tools:
- RARS (RISC-V Assembler und Runtime Simulator)
- Venus (Web-basierter RISC-V Simulator)
- Spike, GDB und riscv64-unknown-elf-gcc
- Verilator (für RTL-Tests)
- Linux, Make, Git
