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Ich entwerfe einen I2C-, SPI- oder UART-Controller für dein FPGA
RTL-Verifikations- und FPGA-Designingenieur
ASIC-Design- und Verifikationsingenieur mit über 3 Jahren Branchenerfahrung in RTL-Verifikation und Timing-Closure, einschließlich Tape-out auf 12 nm. Ich unterstütze Hardware-Teams, Startups und Stud...
Über diesen Service
Ich entwerfe und verifiziere serielle Protokoll-Controller in Verilog/SystemVerilog, mit Ziel Xilinx FPGAs und Vivado.
Was du bekommst:
- Synthesizable RTL für I2C, SPI oder UART (je nach Bedarf Master/Slave)
- Selbstprüfende Testbench und Simulationsergebnisse
- Konfigurierbare Parameter (Baudrate, Clock Divider, Datenbreite)
- Vivado-kompatible Dateien und eine kurze Integrationsanleitung
Ich habe diese Controller in ein funktionsfähiges speicher-zugeordnete System auf Artix-7 integriert. Sag mir das Protokoll, die Frequenz und gewünschte Sonderwünsche.
